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#ifndef BOOT_INIT_DRAM_REGDEF_H_
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/* DBSC registers */
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#define DBSC_DBOSCTHL01		0xE67918C4U
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#define DBSC_DBOSCTHL20		0xE67918D0U
#define DBSC_DBOSCTHL21		0xE67918D4U
#define DBSC_DBOSCTHL30		0xE67918D8U
#define DBSC_DBOSCTHL31		0xE67918DCU
#define DBSC_DBOSCTHL40		0xE67918E0U
#define DBSC_DBOSCTHL41		0xE67918E4U
#define DBSC_DBOSCTHL50		0xE67918E8U
#define DBSC_DBOSCTHL51		0xE67918ECU
#define DBSC_DBOSCTHL60		0xE67918F0U
#define DBSC_DBOSCTHL61		0xE67918F4U
#define DBSC_DBOSCTHL70		0xE67918F8U
#define DBSC_DBOSCTHL71		0xE67918FCU
#define DBSC_DBMEMSWAPCONF0	0xE6792000U

/* CPG registers */
#define CPG_SRCR4		0xE61500BCU
#define CPG_PLLECR		0xE61500D0U
#define CPG_CPGWPR		0xE6150900U
#define CPG_CPGWPCR		0xE6150904U
#define CPG_SRSTCLR4		0xE6150950U

/* MODE Monitor registers */
#define RST_MODEMR		0xE6160060U

#endif /* BOOT_INIT_DRAM_REGDEF_H_*/